Le projet de version 0.5 de la spécification PCIe (Peripheral Component Interconnect Express) de huitième génération a été dévoilé plus tôt que prévu,tandis que l'achèvement officiel de la norme complète reste prévu pour 2028.
Les interconnexions PCIe servent de canaux critiques pour connecter le matériel périphérique à haute vitesse aux systèmes hôtes.0 composants tels que les SSD sont disponibles dans le commerceLa spécification finale de PCIe 7.0 a été publiée et l'itération de PCIe 8.0 est activement en cours.
Vélosité totale par voie de circulation
En raison des charges de travail informatiques de plus en plus complexes et de la demande des utilisateurs pour un traitement des données plus rapide, diverses architectures informatiques, y compris x86, GPU,Arm et RISC-V améliorent continuellement les performances informatiquesLa mise à niveau des performances nécessite des puces informatiques pour réaliser une entrée et une sortie de données plus rapides.et les liaisons d'interconnexion reliant ces périphériques doivent également augmenter les vitesses de transmission pour suivre le rythme.
Traditionnellement, le PCIe agit comme le support de connexion entre les processeurs et les GPU.inciter les fabricants à adopter des technologies d'interconnexion dédiées telles que NVLink de NvidiaEn tant que norme d'interconnexion dominante pour les processeurs d'architecture x86, le PCIe doit continuer à s'itérer pour correspondre à l'amélioration des performances des générations de processeurs successives.
Pour s'adapter à l'augmentation du flux de données dans les systèmes informatiques, chaque nouvelle génération PCIe double la vitesse de transfert de son prédécesseur.
Une liaison PCIe complète se compose de plusieurs voies parallèles, la bande passante de chaque voie étant améliorée pour chaque génération.deux fois la vitesse de 128 GT/s de PCIe 7.0Un graphique dédié démontre intuitivement le bond de vitesse significatif apporté par les mises à niveau générationnelles.
Servant de première édition officielle de la norme, le projet v0.5 intègre les commentaires d'optimisation soumis par les membres du PCI-SIG après la publication du projet 0.3 en septembre 2025.L'organisation déclare que le PCIe 8La spécification.0 est conçue pour fournir une bande passante élevée et une faible latence pour les industries à forte densité de données, couvrant l'intelligence artificielle, les centres de données, les réseaux à grande vitesse,le calcul de bord et le calcul quantique.
Les principaux objectifs de développement de la norme PCIe de huitième génération sont définis comme suit:
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Réaliser un débit brut de 256,0 GT/s, avec un débit bidirectionnel allant jusqu'à 1,0 TB/s sous la configuration x16
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Effectuer des recherches et une évaluation sur les technologies innovantes de connecteurs
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Répondre aux normes prédéfinies en matière de latence, de correction d'erreur (FEC) et de fiabilité opérationnelle
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Maintenir la rétrocompatibilité avec toutes les générations précédentes de PCIe
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Optimiser la bande passante de transmission par itération et amélioration du protocole
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Adopter des moyens techniques diversifiés pour réduire la consommation d'énergie
Les appareils destinés au marché de masse prenant en charge PCIe 8.0 devraient être lancés à partir de 2030.La prochaine génération devrait doubler la vitesse de transfert à voie unique à 512 GT/s, dont le projet de spécification sera publié en 2031, et la technologie de transmission optique devrait jouer un rôle essentiel dans la nouvelle itération.
Avec plus de 1 000 membres institutionnels, le PCI-SIG reflète l'application étendue de la norme d'interconnexion PCIe.5 projet par l'intermédiaire de l'espace de travail des membres de CausewayLes autres entreprises et institutions qualifiées peuvent suivre le lien officiel pour compléter leur inscription à l'ICS.
La Commission a examiné les informations fournies par les autorités chinoises.
Sandy Yang, directeur de la stratégie mondiale
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